Memori akses acak dinamis: Perbedaan antara revisi
Konten dihapus Konten ditambahkan
Tidak ada ringkasan suntingan |
k →top: clean up |
||
| (23 revisi perantara oleh 17 pengguna tidak ditampilkan) | |||
Baris 1:
{{terjemah|Inggris}}
Keuntungan dari DRAM adalah kesederhanaan struktural: hanya satu transistor dan kapasitor yang diperlukan per bit, dibandingkan dengan empat di Transistor SRAM. Hal ini memungkinkan DRAM untuk mencapai kepadatan sangat tinggi. Tidak seperti flash memori, memori DRAM itu mudah "menguap" karena kehilangan datanya bila kehilangan aliran listrik.
== Prinsip
DRAM biasanya diatur dalam persegi array satu kapasitor dan transistor per sel. Panjang garis yang menghubungkan setiap baris dikenal sebagai "baris kata". Setiap kolom sedikitnya terdiri dari dua baris, masing-masing terhubung ke setiap penyimpanan sel di kolom. Mereka biasanya dikenal sebagai + dan - bit baris. Amplifier perasa pada dasarnya adalah sepasang inverters lintas yang terhubung antara bit baris. Yakni, inverter pertama terhubung dari + bit baris ke - bit baris, dan yang kedua terhubung dari - baris ke bit + baris.
Untuk membaca bit baris dari kolom, terjadi operasi berikut:
# Amplifier perasa dinonaktifkan dan bit baris di precharge ke saluran yang tepat sesuai dengan tegangan yang tinggi antara menengah dan rendahnya tingkat logika. Bit baris yang akan dibangun simetris agar mereka seimbang dan setepat mungkin.
# Precharge sirkuit dinonaktifkan. Karena bit baris yang sangat panjang, kapasitas mereka akan memegang precharge tegangan untuk waktu yang singkat. Ini adalah contoh dari logika dinamis.
# "Baris kata" yang dipilih digerakkan tinggi. Ini menghubungkan satu kapasitor penyimpanan dengan salah satu dari dua baris bit. Charge ini dipakai bersama-sama oleh penyimpanan sel terpilih dan bit baris yang sesuai, yang sedikit mengubah tegangan pada baris.Walaupun setiap usaha dilakukan untuk menjaga kapasitas di penyimpanan sel tinggi dan kapasitas dari baris bit rendah, Kapasitasnya proporsional sesuai ukuran fisik, dan panjang saluran bit baris yang berarti efek net yang sangat kecil gangguan per satu bit baris tegangan.
# Amplifier perasa diaktifkan. Tanggapan positif (Positive feedback) mengambil alih dan menperkecil perbedaan tegangan kecil sampai satu baris bit sepenuhnya rendah dan yang lain sepenuhnya tinggi.Pada tahap ini, baris "terbuka" dan kolom dapat dipilih.
Baris 39 ⟶ 38:
| t<sub>CAS</sub> || 8 ns || 10 ns || /CAS rendah lebar pulse minimum
|}
=== Kemasan DRAM ===
Dinamis random akses memori yang diproduksi sebagai sirkuit terpadu(ICS) disimpan dalam gudang dan dimount ke dalam paket plastik dengan logam pin untuk koneksi ke kontrol sinyal dan bus. Saat ini, ini adalah paket DRAM pada umumnya sering dikumpulkan ke modul plug-in untuk penanganan lebih mudah.
Baris 68:
# RIMM 184-pin ([[RDRAM]])
# DIMM 240-pin ([[DDR2 SDRAM]]/[[DDR3 SDRAM]])
{{Authority control}}
[[Kategori:Memori komputer]]
[[el:Μνήμη τυχαίας προσπέλασης#Τύποι μνήμης RAM]]
| |||